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      基于李氏制約競爭計(jì)數(shù)編碼的16選1數(shù)據(jù)選擇電路的制作方法

      文檔序號:7526728閱讀:247來源:國知局
      專利名稱:基于李氏制約競爭計(jì)數(shù)編碼的16選1數(shù)據(jù)選擇電路的制作方法
      技術(shù)領(lǐng)域
      本發(fā)明屬于數(shù)字邏輯電路領(lǐng)域,特別是指一種基于李氏制約競爭計(jì)數(shù)編碼的16選I數(shù)據(jù)選擇電路。
      背景技術(shù)
      在數(shù)字信號的傳輸過程中,有時(shí)需要從一組輸入數(shù)據(jù)中選出某一個(gè)來,這時(shí)就需要用到一種稱為數(shù)據(jù)選擇器的邏輯電路。數(shù)據(jù)選擇器(MUX)的邏輯功能是在地址選擇信號的控制下,從多路數(shù)據(jù)中選擇一路數(shù)據(jù)作為輸出信號。目前在數(shù)據(jù)選擇器的設(shè)計(jì)領(lǐng)域,制約競爭計(jì)數(shù)碼因其優(yōu)勢得到廣泛的應(yīng)用。目前常用的是格雷碼,其碼制與十進(jìn)制數(shù)字的對應(yīng)關(guān)系可參考表1:表I
      十進(jìn)制數(shù)j格雷碼~
      O0000
      2
      30010
      40110
      5Ο Τ
      60101
      70100
      81100 9 Τ Tm
      Tl1110
      121010
      權(quán)利要求
      1.一種基于李氏制約競爭計(jì)數(shù)編碼的16選I數(shù)據(jù)選擇電路,用于將4位李氏制約競爭計(jì)數(shù)編碼作為4個(gè)地址輸入信號使用,并在4個(gè)地址輸入信號的控制下,從16路數(shù)據(jù)輸入信號中選擇I路數(shù)據(jù)輸入信號作為輸出信號;其特征在于:包括8個(gè)非門、16個(gè)五輸入與門和5個(gè)四輸入或門; 所述4位李氏制約競爭計(jì)數(shù)編碼的碼位由第一位至第四位依次升高,所述16路數(shù)據(jù)輸入信號的碼位由第一位至第十六位依次升高; 所述16路數(shù)據(jù)輸入信號從低位到高位依次連接第一至第十六五輸入與門的第一輸入端; 所述16路數(shù)據(jù)輸入信號從低位到高位依次連接五輸入與門的第一輸入端; 所述第一非門的輸入端用于輸入4個(gè)地址輸入信號的第一位,而輸出端分別連接第一、十至十六五輸入與門的第二輸入端;所述第一非門的輸出端還連接第五非門的輸入端,所述第五非門的輸出端分別連接第二至九五輸入與門的第二輸入端; 所述第二非門的輸入端用于輸入4個(gè)地址輸入信號的第二位,而輸出端分別連接第一至三、七、八、十二至十四五輸入與門的第三輸入端;所述第二非門的輸出端還連接第六非門的輸入端,所述第六非門的輸出端分別連接第四至六、九至1、十五、十六五輸入與門的第三輸入端; 所述第三非門的輸入端用于輸入4個(gè)地址輸入信號的第三位,而輸出端分別連接第一至五、八、十四至十六五輸入與門的第四輸入端;所述第三非門的輸出端還連接第七非門的輸入端,所述第七非門的輸出端分別連接第六、七、九至十三五輸入與門的第四輸入端;所述第四非門的輸入端用于輸入4個(gè)地址輸入信號的第四位,而輸出端分別連接第一、二、五、1、十二、十六五輸入與門的第五輸入端;所述第四非門的輸出端還連接第八非門的輸入端,所述第八非門的輸出端分別連接第三、四、六至十、十三至十五五輸入與門的第五輸入端; 所述第一四輸入或門的輸入端分別連接第一至四非門的輸出端,第二四輸入或門的輸入端分別連接第五至八非門的輸出端,第三四輸入或門的輸入端分別連接第九至十二非門的輸出端,第四四輸入或門的輸入端分別連接第十三至十六非門的輸出端,而所述第一至四四輸入或門的輸出端分別連接第五四輸入或門的輸入端,第五四輸入或門的輸出端用以輸出被選擇的I路數(shù)據(jù)。
      全文摘要
      本發(fā)明公開一種基于李氏制約競爭計(jì)數(shù)編碼的16選1數(shù)據(jù)選擇器,包括8個(gè)非門、16個(gè)與門和5個(gè)或門,地址輸入信號為A0、A1、A2和A3,各分別對應(yīng)于一個(gè)非門,數(shù)據(jù)輸入信號為D0,D1,D2……D15,輸出為Y,即為D0,D1,D2……D15中的一個(gè);本發(fā)明所設(shè)計(jì)的基于李氏制約競爭計(jì)數(shù)編碼的16選1數(shù)據(jù)選擇電路以李氏制約競爭計(jì)數(shù)編碼為基礎(chǔ),作為數(shù)據(jù)選擇輸出的Y有規(guī)律可循,并且此種數(shù)據(jù)選擇電路具有特征序列,能夠提高信號傳輸?shù)目煽啃?,與此同時(shí)還降低了數(shù)據(jù)選擇的誤碼率。
      文檔編號H03K19/00GK103227632SQ20131002707
      公開日2013年7月31日 申請日期2013年1月24日 優(yōu)先權(quán)日2013年1月24日
      發(fā)明者王剛, 張青, 趙霞, 董乾, 劉勇, 孫小羊, 陳德斌, 李冰, 王浩 申請人:東南大學(xué)
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