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      一種全包圍柵結(jié)構(gòu)的制造方法技術(shù)資料下載

      技術(shù)編號(hào):9377837

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      半導(dǎo)體集成電路(IC)工業(yè)經(jīng)歷了迅速的發(fā)展。在IC的發(fā)展過程中,通常增大了 功能密度(即每個(gè)芯片區(qū)域的互連器件的數(shù)量),而減小了幾何尺寸(即使用制造工藝可以 制造的最小器件或互連線)。這種按比例縮小的工藝優(yōu)點(diǎn)在于提高了生產(chǎn)效率并且降低了 相關(guān)費(fèi)用。同時(shí),這種按比例縮小的工藝也增加了處理和制造 IC的復(fù)雜性。 在尋求更高的器件密度、更高的性能以及更低的費(fèi)用的過程中,隨著集成電路工 藝持續(xù)發(fā)展到納米技術(shù)工藝節(jié)點(diǎn),一些制造廠商已經(jīng)開始考慮如何從平面CMOS晶體...
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